PE3293典型应用电路

ＰＥ３２９３非常适合基于ＰＣＳ基站的ＣＤＭＡ无线通信系统，它能保持很低的相位噪声和寄生输出成分，而且功耗非常低，使用也很方便，几乎不需要多少外围电路。它的另一个优点是具有一个高阻ＶＣＯ输入引脚，因此这就避免了在ＶＣＯ、ＰＬＬ和ＲＦ电路中使用功分器的麻烦。

在频率综合器的设计中，环路滤波器的优化设计要权衡很多因素，环路带宽一般定为步进频率的１０％。对二阶环来说，ＰＥ３２９３可以提供快速的锁定时间，而且环路带宽的增加还可以减少锁定时间，但过宽又会导致系统稳定性变差。如果对锁定时间的要求不是很高的话，较窄的二阶环可残留较少的ＦＭ而且不需要增加额外的器件；而三阶环在锁定时间和残留ＦＭ中可进行较好的协调。ＰＥ３２９３器件中的ＰＬＬ自带接地电容和成形电路，其中ＰＬＬ１自带５０ｐＦ的接地电容，而ＰＬＬ２自带１００ｐＦ的接地电容。对于窄带环路滤波来说，这些电容是相对透明的。但随着环路带宽的增加，内部电容将起主要作用，它将限制环路带宽。而对大多数应用系统来说，这不是考虑的主要因素。比如，当ＰＬＬ１用作步进频率为８０ｋＨｚ时，环路带宽可以为８ｋＨｚ。这对于二阶环和三阶环的环路滤波器的设计来说，利用Ｐｅｒｅｇｒｉｎｅ公司的软件Ｉｎｔ－Ｎ＿ＰＤ＿ＬＰＦ很容易实现。该软件可以在Ｐｅｒｅｇｒｉｎｅ公司的主页上免费下载。

数据输入端Ｄａｔａ输入的数据在时钟输入Ｃｌｏｃｋ 的上升沿逐次移入２１ｂｉｔ的移位寄存器且ＭＳＢ(Ｍ１６)在先，因此，当ＬＥ为高时，数据送入由图４所示的最后２位地址位所决定的２１ｂｉｔ移位寄存器的相应地址中。比如，当程序对计数器Ａ１进行控制 时，送入寄存器的最后两比特(Ｓ０, Ｓ１)应为(１,１)，计数器Ａ１中的５比特位可以按表２设置。因此，在正常情况下，即使不用ＰＬＬ２ＩＦ Ｓ１６也应设为０。应注意的是，ＰＥ３２９３的工作模式、鉴相器极性和功率控制均可以由Ｃ１０～Ｃ１４和Ｃ２０～Ｃ２４来控制。

表2 PE3293的计数器设计表