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PE3293典型应用电路

作者:dolphin时间:2012-10-31

PE3293非常适合基于PCS基站的CDMA无线通信系统,它能保持很低的相位噪声和寄生输出成分,而且功耗非常低,使用也很方便,几乎不需要多少外围电路。它的另一个优点是具有一个高阻VCO输入引脚,因此这就避免了在VCO、PLL和RF电路中使用功分器的麻烦。

在频率综合器的设计中,环路滤波器的优化设计要权衡很多因素,环路带宽一般定为步进频率的10%。对二阶环来说,PE3293可以提供快速的锁定时间,而且环路带宽的增加还可以减少锁定时间,但过宽又会导致系统稳定性变差。如果对锁定时间的要求不是很高的话,较窄的二阶环可残留较少的FM而且不需要增加额外的器件;而三阶环在锁定时间和残留FM中可进行较好的协调。PE3293器件中的PLL自带接地电容和成形电路,其中PLL1自带50pF的接地电容,而PLL2自带100pF的接地电容。对于窄带环路滤波来说,这些电容是相对透明的。但随着环路带宽的增加,内部电容将起主要作用,它将限制环路带宽。而对大多数应用系统来说,这不是考虑的主要因素。比如,当PLL1用作步进频率为80kHz时,环路带宽可以为8kHz。这对于二阶环和三阶环的环路滤波器的设计来说,利用Peregrine公司的软件Int-N_PD_LPF很容易实现。该软件可以在Peregrine公司的主页上免费下载。
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数据输入端Data输入的数据在时钟输入Clock 的上升沿逐次移入21bit的移位寄存器且MSB(M16)在先,因此,当LE为高时,数据送入由图4所示的最后2位地址位所决定的21bit移位寄存器的相应地址中。比如,当程序对计数器A1进行控制 时,送入寄存器的最后两比特(S0, S1)应为(1,1),计数器A1中的5比特位可以按表2设置。因此,在正常情况下,即使不用PLL2IF S16也应设为0。应注意的是,PE3293的工作模式、鉴相器极性和功率控制均可以由C10~C14和C20~C24来控制。

表2 PE3293的计数器设计表


关键词: 电路 应用 典型 st uv wx yz qr

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分频比

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